Siwave仿真PCB差分线， 如何设置 PORT 的PORT Negative“Terminal”
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我在使用Siwave 导出PCB中差分线 S参数的时候，选择不同的芯片管脚做PORT Negative“Terminal”，
或者
、其输出8端口S参数，在Ansys Design中分析时，
其输出结果都不一样，前者
，后者不知道我的设置方法有问题，还是如此设置本来就不对?还望大侠赐教！
jkdrathh
关注小编问题，同问
你好 你的问题解决没?
同问··
xuexue haodongxi
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