ADS里包络仿真设置不同步长放出来的图完全不一样
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做锁相环的仿真，包络仿真时不同步长仿出来的结果完全不一样，可能是什么原因呀，很困惑，忘大虾指点
我曾在DSP设计原理图中做过系统级仿真，在那里仿真步长决定了射频复包络信号带宽，从而影响信号特性，不知电路包络仿真控制器是不是也是这样规定的，你再看看！
谢谢，可是这儿也早不到其他什么东西，很迷惑
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