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今天被我们的领导鄙视了

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我正在画pcb,领导看到了,说这个低级的活,不应该是我干的!
画pcb容易,画好pcb太难了!这是我的感觉。
我是不放心其他人画的pcb我自己才上手的,没表扬无所谓,还说我浪费!
郁闷,超级郁闷。

是啊,的确应该bs;估计领导的心在滴血

意见:你要什么都会干,那就别干了
所以为什么软硬分开,软件团队合作?
其中一个原因就是公司离开你还能继续,你离开公司就啥也不是.
当工程师考虑战略问题的时候,就是要离开的时候

不干就不干吧!

.............

领导用心‘良苦’啊! 嘿嘿!

不太明白

KAO,你多少钱一天?画PCB的多少钱一天?
你的薪水够招多少个画PCB的了?
领导稍微会想的,都会算这个帐吧?

小日本在这方面做得好
就连生线产上的工人,一等工不准做二等工的活儿。
坐着别动就行,报仇的机会到了,工头要被叫去骂死。

国企这种情况很多
毕业找工作的时候去过一家国企,他们是搞军工的,技术部的人搞fpga就是从画板子开始一直到系统都是他一个人搞,效率n低

难道画pcb技术含量就那么低?
我画pcb的时候,是得考虑对应的软件怎么写的。
如何在pcb的布通率,emc,成本以及软件难度之间如何平衡的。
pcb也不是简单把线接通就完事的。我几乎所有的线都调整了一遍,
我的想法是,第一版pcb我来做,以后的改版啥的就不管了。
核心区域别给我动。

呵呵,这回顶

“核心区域别给我动”,核心到什么地步?
所以领导不让你动PCB...

就是cpu+sdram+falsh 部分,外围我想全部用GPIO
以前不是,很容易造成告诉信号满板子飞。
EMC解决,得挂一堆东西。
这点,我可以用软件保证功能实现。
只是改变了一些软件的写法罢了。

我觉得你老大说的对!
你应该把关的是
1:把关原理图
2:PCB结构图(你画一个结构草图就行,对一些特定的信号线的要求,标出来),然后还是把关
3:培训新人
4:写公司内部的设计规定,不一定很详细,先是大纲,再细化,不是每一件事儿,都要自己做才放心的,用规定去约束。
哈哈,你总是这也不放心,那也不放心,老自己画电路板,哪天是个头呀?要学会放下,放下。,公司有了你会更好,没了你也不能解散,所以,你的存在,是让公司更好!做好30%最重要的事儿,剩下的那70%不是那么总要得琐事儿,就放下吧!

俺不是那个职位,俺也不管了。
另外,我讲明白的功夫,自己都做完了。
我们就两个画pcb,不能专门掉一个给我画吧?
那样耽误的是两个人的功夫。原理图也是。
人员成本得增加几倍
是不是应该考虑换公司了?我现在仅仅是负责软件os,
实际上,现在很多硬件软件os,应用程序的问题很多同事
都在问我。
而且,去年没有加薪。去年来的新人我培训的差不多了,
基本上我跑了,项目影响不是很大了。

正规化是要成本的,空口说大话谁都会。
正规按软件工程做事,小公司立马息火。

我做到这件事按照正规去做的人力需求
总体设计1人,2个月
原理图设计,1个月
pcb设计1-2周
verilog代码1月需要招人,招人得一个月,甚至更多
调试2月(未确定因素,以及设计,原理图,verilog,物料等的协调)
失败了,重来,goto1
我自己做:调查,一个月,学verilog一个月,原理图+pcb一个半月。
verilogsdram扫描时序代码已经找到,编译通过。
原理图,pcb调过线,有备用电路,有几条技术路线可走。(正规设计只一条)
只要有一条线成功,就可以定型。
如果我能调动足够的人手,有verilog的高手配合,还有足够的钱买开发板。
一个月足够了,这三件事并行处理。

有时候调整一下原理图网络,PCB好走很多。

去年没有加薪......
这要看你现在的薪水是多少......
现在是经济危机,很多人等着抢你的饭碗呢

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