求教：1.5bit/级流水线ADC相关问题

就看你采用单端还是差分了
0实际代表的共模电压
Vref代表量程，这里表示为1.5-0.5=1
则共模电压为（1.5+0.5）/2=1;
因此我认为你的+-Vref/4应该为0.75和1.25
子DAC的输出+-Vref和0应该取0.75 1 和1.25
差分就好办 就是2个输入的差，注意此时Vref由（Vref+）-（Vref-）产生，按照上面单端的原理推测
这个就是我的理解

谢谢楼上的兄弟。
差分的话，能不能帮我讲解具体点。
谢谢你了。

这是个很基本的问题。
随便找篇文章上都会有详细的说明的。
如果输入范围是+1~-1那么每一级的两个参考电平分别为+0.5和-0.5

论文里面讲的都是正负电压的，但我们设计的是只有正电压。所以就晕晕的。
还有我们都是单信号输入的。怎么转用差分设计?

xieixze

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