关于分频器Verilog AMS描述的问题
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向各位高手请教一个问题，用Verilog A写一个锁相环用的2分频电路，输入为正弦信号，已知主频，幅度，并带有一定的初始相位phase，要求分频器产生一组正交信号，初学Verilog A,不知道该怎么写这么复杂的，请高手不吝解答，多谢！
真心求助啊！
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