cdr锁定检测问题

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相位插入型 PLL锁定可以通过计PLL产生时钟个数和基准时钟个数来比较判断是否锁定。
相位插入型CDR怎么判断呢，时钟周期基本相差不大?只是检测相位是否变动大，怎么设计，有没有什么参考呢?
求指导啊~只是给出一信号说是否锁定即可。
本来想是不是通过控制相位的控制位来判断是否锁定，但是时间上相邻的控制位应该相差不大，时间较久的话，也不是很准确。而且我这个CDR的相位精度为π/32，控制应该是在64位，是不是做起来也比较复杂。