求助：动态比较器的verilog-A代码？
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请问一下，有人知道怎么编动态锁存比较器的verilog-A代码吗?比如希望时钟为高时比较器被复位，输出被拉高，时钟为低时比较器只进行一次比较。谢谢了！
参见function库里的比较器，自己稍微改改就能实现了
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